Transcript Oct. 10, 07 ツールの紹介と新規起動 2

ツールの紹介と新規起動
プロジェクト演習
CS28 川口 博
開発ツール
• DK Design Suite
– Handel-Cの開発環境
• Xilinx ISE
– FPGAの配線ツール
• FTU3 (File Transfer Utility?)
– 配線情報ファイルをRC10に転送
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ディレクトリ構造
C:\
proj\ （新規作成してください）
example1\ （作業ディレクトリ）
example1.hcc （ソース）
colours.h （ヘッダーファイル）
numbers8x8.h （ヘッダーファイル）
EDIF\ （出力ディレクトリ）
FPGA\ （ISE用ディレクトリ）
まだ作らなくて大丈夫
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DK Design Suiteの新規起動
• Handel-Cの開発環境
– ソースファイルの編集、ビルド
• デスクトップの をダブルクリックで起動
• またはスタート>プログラム>Celoxica>DK
Design Suite>DKで起動
• 2回目の起動からは作業ディレクトリの.hw
ファイルをダブルクリック
デスクトップのアイコンをダブルクリックすると
新規起動になってしまう
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DK Design Suite起動画面
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DK Options
• DK Toolbar:
C:\Program Files\Celoxica\PDK\Hardware\Include
Tools>Options…
• Include filesと
Library modulesの
設定
C:\Program Files\Celoxica\PDK\Hardware\Lib
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DK New Project
•
•
•
•
Toolbar: File>New…
Project>Xilinx Spartan-3/3L Chip
Location:>C:\proj\
Project Name: example1
Xilinx Spartan-3/3L Chip
example1
C:\proj\
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ソースとヘッダーファイルのダウンロード
• http://www28.cs.kobe-u.ac.jp/~kawapy/class/proj/
からダウンロードしたファイルを
C:\proj\example1\に置く
– example1.hcc （ソース）
– colours.h （ヘッダーファイル）
– numbers8x8.h （ヘッダーファイル）
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DK Add .hcc files to Project
• Project:example1を右クリック>Add Files to
Folder…
• example1.hccを選択
Example1.hcc
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DK Settings: Settings>Build commands
• Project:example1を右クリック>Settings
• Settings for:>EDIF
• Building commandsはそのままでよい
EDIF
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DK Settings>Linker
• Object/library modules:に
stdlib.hcl,rc10.hcl,pal_rc10.hcl,pal_mouse.
hclを追加
stdlib.hcl,rc10.hcl,pal_rc10.hcl,pal_mouse.hcl
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DK Settings>Chip
•
•
•
•
Family>Xilinx Spartan-3/3L (XilinxSpartan3)
Device:>xc3s1500l
Package:>fg320
Speed Grade:>4
Xilinx Spartan-3/3L (XilinxSpartan3)
xc3s1500l
fg320
4
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DK Settings>Optimization
• この通りに設定
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DK Settings>Synthesis
• Expand netlist for:>Speed (-N+speed)
• Limit ALUs of type:>MULT18X18 to 32
Speed (-N+speed)
MULT18X18
32
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DK Settings>Debug
• Debugはそのままでよい
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DK Settings>Preprocessor
• Preprocessor definitions:
NDEBUG,__EDIF__,USE_RC10
（USE_RC10を追加、この_はひとつだけ）
NDEBUG,__EDIF__,USE_RC10
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Settings>General
• Intermediate files:とOutput files:が
EDIFとなっていることを確認
EDIF
EDIF
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DK Edit Source Files
• Project example1にあるexample1.hccを
ダブルクリック\
example1.hcc
編集画面
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DK Build
• Toolbar: Build>Build example1 (F7)
• example1\EDIF\example1.edfができる
EDIF
メッセージ
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Xilinx ISE新規起動
• FPGAの配線ツール
– ネットリスト.edfから配線情報.bitを作る
• デスクトップの をダブルクリックで起動
• またはスタート>プログラム>Xilinx ISE 8.2i>
Project Navigatorで起動
• 2回目の起動からもデスクトップのアイコンを
ダブルクリック
前回終了時のProjectを保持している
• New Projectしたい場合は現在のProjectを
Toolbar: Tool>Close Projectでクローズ
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Xilinx ISE起動画面
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ISE Toolbar: File>New Project… Wizard
• Project Location>C:\proj\example1\EDIF\
• Project Name: FPGA
• Top-Level Source Type:>EDIF
FPGA
C:\proj\example1\EDIF\
EDIF
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ISE Wizard – Import EDIF/NGC Project
• Input Design:
C:/proj/example/EDIF/example1.edf
C:/proj/example1/EDIF/example1.edf
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ISE Wizard – Device Properties
• Product Category>All, Family>Spartan3,
Device>XC3S1500L, Package>FG320,
Speed>-4, Simulator>ISE Simulator
All
Spartan3
XC3S1500L
FG320
-4
ISE Simulator
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ISE Wizard – Project Summary
• Finish
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Implement Design
• Implement Design>ダブルクリック
Implement Design
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Generate Programming File (.bit file)
• Generate Programming File>ダブルクリック
• C:\proj\example1\EDIF\FPGA\example1.bitがで
きる
Generate Programming File
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ISE 2回目以降起動時の注意点
• Example1右クリック>Add Copy of Source…
• C:\proj\example1\EDIF\example1.edfを選択
（C:\proj\example1\EDIF\FPGA\example1.edfも存在す
るが、こちらは選ばないこと）
Timestampを確認
C:\proj\example1\EDIF\example1.edf
右クリック>
Add Copy of Source…>
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FTU新規起動
• 配線情報ファイルをRC10に転送
– ネットリスト.edfから配線情報.bitを作る
• デスクトップの をダブルクリックで起動
（デスクトップにアイコンがない場合は
ショートカットを作成）
• またはスタート>プログラム>Celoxica>Board
Support>Software>FTU3
• 2回目の起動からもアイコンをダブルクリック
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FTU起動画面
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FTU Browse 1
• Browseで.bitファイルを選択
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FTU Browse 2
• Example1.bitを選択
C:/proj/example1/EDIF/FPGA/example1.bit
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• example1.ncdをRC10に転送
example1.ncd
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いくつかのデモ
• C:\Program Files\Celoxica\PDK\Examples\と
C:\Program Files\Celoxica\PDK\Tutorials\を
C:\proj\にコピー
• C:\proj\Examples\PAL\Examples.hw
– FrameBufferBRAM\, Mouse\, …
• C:\proj\Examples\PixelStreams\Examples.hw
– GUI, VideoGen, …
• C:\proj\Examples\PSL\RC10\RC10.hw
– MidiFlash
• Xilinx Spartan-3/3L ChipのProjectは全て動作
いろんなことができる！
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