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CHAPTER
14
循序邏輯電路
第14章
循序邏輯電路
2
14-1 記憶元件
在數位邏輯電路中，具有儲存數位訊號能力
的元件稱之為「記憶元件」，包括：
閂鎖(Latch)
暫存器(Register)
正反器(Flip-Flop)
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14-2 暫存器
 具有同步「重置」訊號控制的 8 位元暫存器
8
Data_In
Synchronous
8 Bits
Register
8
Data_Out
Reset
Clock
 Sync_Reg 的邏輯符號
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 Sync_Reg 的模擬結果
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 具有非同步「重置」訊號控制的 8 位元暫存器
8
Data_In
Asynchronous 8
8 Bits
Register
Data_Out
Reset
Clock
 Async_Reg 的邏輯符號
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循序邏輯電路
8
 Async_Reg 的模擬結果
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14-3 移位暫存器
14-3-1 串進串出移位暫存器
 4 位元串進串出移位暫存器的電路圖
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第14章
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 SISO_Reg 的模擬結果
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14-3-2 串進並出移位暫存器
 4 位元串進並出移位暫存器的電路圖
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 SIPO_Reg 的模擬結果
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14-3-3 並進串出移位暫存器
 4 位元並進串出移位暫存器的電路圖
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 PISO_Reg 的模擬結果
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14-3-4 並進並出移位暫存器
 4 位元並進並出移位暫存器的電路圖
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 PIPO_Reg 的模擬結果
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14-4 計數器電路
範例一
10位元(0~1023)上數計數器，判斷計數值輸出置於process
區塊中，因此「輸出延遲」(output latency)較小、面積較大。
10
Reset
Out
10位元正數計數器
Zero
Max_1023
Even
 Counter_In_Process 的邏輯符號
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 Counter_In_Process 的模擬結果
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14-5 除頻電路
「除 N 器」
「除N器」，可程式的除頻器(將輸入時脈訊號頻率除以N之後再輸出)。
LoadModN
除 N 器
Data_N
Clock_ModN_Out
Clock_In
 除 N 器的邏輯符號
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 FreqModN 的模擬結果
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